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利用先進(jìn)EDA工具應(yīng)對(duì)低功耗設(shè)計(jì)挑戰(zhàn)

發(fā)布日期:2022-07-14 點(diǎn)擊率:57

成為半導(dǎo)體產(chǎn)業(yè)的熱點(diǎn)問(wèn)題。過(guò)去,對(duì)于集成器件制造商(IDM)來(lái)說(shuō),最直接的作法就是通過(guò)先進(jìn)的制程工藝和材料比如低K介質(zhì)來(lái)解決,低功率設(shè)計(jì)可以通過(guò)將自己設(shè)計(jì)團(tuán)隊(duì)的技能和經(jīng)驗(yàn)進(jìn)行結(jié)合而實(shí)現(xiàn)。

在設(shè)計(jì)早期進(jìn)行有效的功率評(píng)估

F1: 很多設(shè)計(jì)相對(duì)邏輯是“相連的”,但對(duì)功耗是“不相連”的,且不能自動(dòng)完成設(shè)計(jì)
F1: 很多設(shè)計(jì)相對(duì)邏輯是“相連的”,但對(duì)功耗是“不相連”的,且不能自動(dòng)完成設(shè)計(jì)

多種低功耗設(shè)計(jì)解決方案應(yīng)對(duì)功耗挑戰(zhàn)

F2: Synopsys Eclypse低功率解決方案
F2: Synopsys Eclypse低功率解決方案

Synopsys Eclypse低功率解決方案

Cadence低功耗設(shè)計(jì)方法學(xué)錦囊

F3: Cadence低功耗設(shè)計(jì)方法學(xué)錦囊
F3: Cadence低功耗設(shè)計(jì)方法學(xué)錦囊

IC設(shè)計(jì)低功耗標(biāo)準(zhǔn)之爭(zhēng)

SII設(shè)計(jì)流程中定義功率設(shè)計(jì)意圖和約束條件,并且二者的實(shí)現(xiàn)方法也非常相似。

作者:邵樂(lè)峰


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